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车文洁; 高献伟;
北京电子科技学院;
乘法器; FPGA; 硬件描述语言;
机译:基于VEDIC乘法器和可逆逻辑门的基于FPGA的64位MAC单元的设计与实现
机译:基于分布式算术和基于乘法器的乘法器用于卫星图像配准的DTCWT体系结构的FPGA实现
机译:基于FPGA的设计与实现固定和浮点数矩阵乘法器:审查
机译:基于FPGA的四重精密浮点乘法器的设计与实现,资源占用较低的FPGA
机译:使用Altera的设计环境和FPGA设计和实现浮点乘法器
机译:基于模型的设计浮点累加器。研究案例:支持向量机内核功能的FPGA实现
机译:基于商用FPGA的可重构计算。设计和实现部分可重配置系统的解决方案=基于商用FPGA的可重配置计算。设计和实现部分可重配置系统的解决方案。
机译:基于单事件翻转发生率的基于sRam的FpGa设计中的容错实现
机译:FPGA上基于GPHL IO标准的节能型VEDIC乘法器设计
机译:分布式微处理器系统与基于宏单元的设计相接口,该设计实现为ASIC或FPGA面包板以及相关的通用总线协议
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