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下一代芯片设计与验证语言:SystemVerilog(验证篇)

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SystemVerilog是下一代芯片设计和验证语言,于2005年12月被标准化为IEEE P1800-2005.本文介绍SystemVerilog发展的过程及其对验证建模的支持,重点讨论其在功能验证方面的重要应用及使用技巧.

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来源
《电子设计应用》|2008年第12期|61-67|共7页
作者
钟文枫;
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作者单位

Mentor Graphics公司;

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原文格式 PDF
正文语种 chi
中图分类计算技术、计算机技术;
关键词
SystemVerilog; 设计和验证语言; 功能验证; 断言; 验证方法学;
入库时间 2023-07-25 16:38:20

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