基于CPLD的8B10B编码器模型的设计

周庆芳

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本文在Altera公司开发的Quartus II开发平台上,利用EDA技术,采用VHDL程序设计输入和原理图设计输入混合设计的方式,基于FPGA数字集成电路提出一种简单实用的8B10B编码器的实现方法,完成8B10B编码器模型的设计.其输入输出特性满足8B10B基本原理和核心算法,实现了设计的要求.

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来源
《教育界》 |2016年第5期|95-95|共1页
作者
周庆芳;
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作者单位

曲靖师范学院教育技术研究所;

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原文格式 PDF
正文语种 chi
中图分类编码器;
关键词
CPLD8; B10B编码器; EDA; indata; 时序仿真;

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