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基于FPGA的半并行FIR滤波器设计

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摘要

为了提高FIR滤波器的运算速度和降低资源消耗,本文提出了一种新颖的半并行FIR虑波器设计方法.该方法有固定的延时,可以根据滤波器抽头数的不同,得到不同的最高数据输入速率.仿真结果表明,该滤波器设计方法在高速数字下变频器的设计中有较好的性能,并且通过优化设计,可以在一个FPGA实现多个滤波器模块.

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来源
《数字通信世界》 |2010年第5期|67-69|共3页
作者
王春来; 欧阳喜;
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作者单位

信息工程大学信息工程学院;

信息工程大学信息工程学院;

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正文语种 chi
中图分类
关键词
FIR滤波器; 半并行; FPGA;

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