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翟召岳; 韩志刚;
同济大学电子科学与技术系;
Booth算法; Wallace树; 压缩器; 流水线;
机译:基于吠陀数学的高速32位流水线乘法器的FPGA设计,仿真和原型设计
机译:基于带有SPST的Radix-4修改Booth算法的并行乘法器C累加器设计
机译:基于Radix-2改进Booth算法的并行乘法器-累加器VLSI新架构
机译:使用基数为16的booth编码的华莱士树乘法器设计基于可逆逻辑的32位MAC单元
机译:基于VHDL的浮点乘法器自动流水线方法。
机译:基于小波的ECG描绘算法用于32位整数在线处理
机译:低功耗32位x 32位乘法器设计,采用流水线模块智能关闭1
机译:spIm(斯坦福流水线迭代乘法器):流水线64 X 64位迭代乘法器
机译:使用Booth算法的并行乘法器
机译:具有改进的Booth算法的并行乘法器
机译:利用Booth算法的并行乘法器
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