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邓林; 徐炜遐; 谭德立;
国防科技大学计算机学院;
湖南;
长沙;
410073;
RSA; 加解密; 蒙哥马力; Systolic 阵列;
机译:基于FPGA的AES加解密系统的硬件实现
机译:基于FPGA的可编程逻辑控制器的算术运算的硬件实现
机译:基于FPGA的硬件加密实现RSA算法的改进
机译:平滑粒子网格Ewald倒数和运算引擎(RSCE)的FPGA实现。
机译:基于FPGA的高精度时差信息提取方法及其硬件电路的实现
机译:用于实时视频处理的基于FPGA的软件/硬件协同设计:使用Xilinx Virtex II Pro FPGA的视频接口软件和对比度增强硬件协同设计实现
机译:Rsa功耗分析混淆:动态FpGa架构
机译:生成时钟信号,以实现基于周期的,可重复的基于FPGA的FPGA硬件加速器
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