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一种并行解扰电路的VLSI实现

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摘要

解扰电路是数字电视解扰系统的核心部分.着重介绍了实现并行解扰的电路原理图,从VLSI实现的角度来设计电路结构,给出仿真结果,采用0.35 μm工艺实现.并行解扰电路集成在解调芯片中,在系统时钟28.8 MHz控制下,正常工作,满足数字电视高速数据传输的要求.

著录项

来源
《电子器件》 |2006年第2期|512-514|共3页
作者
杨东; 茆邦琴; 吴建辉;
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作者单位

东南大学国家专用集成电路系统工程技术研究中心,南京,210096;

东南大学国家专用集成电路系统工程技术研究中心,南京,210096;

东南大学国家专用集成电路系统工程技术研究中心,南京,210096;

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原文格式 PDF
正文语种 chi
中图分类大规模集成电路、超大规模集成电路;
关键词
解扰器; 并行; 数字电视;

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