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易湖; 于军;
华中科技大学电子科学与技术系;
扫描格式转换; 双线性插值算法; Vedlog_HDL;
机译:BZK.SAU.FPGA10.1:一种用于教育目的的基于FPGA的微型计算机体系结构设计的模块化方法
机译:基于自适应插值算法和TTS FPGA实现的视频图像缩放技术
机译:基于带有集成双核ARM处理器的XILINX ZYNQ-7000 EPP FPGA的嵌入式处理模块-适用于所有情况的FPGA模块
机译:基于FPGA的数字视频广播系统中的信道编码设计
机译:FPGA使用VHDL设计和开发基于数字视频广播(DVB)的信道编码器
机译:FPGA芯片上的MR图像处理模块的设计
机译:基于FPGA的MRI系统通信模块和脉冲序列生成模块的设计
机译:基于单事件翻转发生率的基于sRam的FpGa设计中的容错实现
机译:通过组合基于fpgas的数字加速器和基于对象的界面来设计通用高性能计算机应用程序的方法
机译:FPGA设计辅助系统,FPGA设计辅助方法和FPGA设计辅助程序
机译:FPGA设计支持系统和FPGA设计支持方法以及FPGA设计支持程序
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