VLSI; crosstalk; error detection; integrated circuit interconnections; microprocessor chips; VLSI interconnects; built-in error detection; crosstalk noise; deep sub-micron technology; delay minimization; energy minimization; error detection requirement; logic faults;
机译:VLSI布局设计中基于网格图的互连延迟最小优化算法
机译:最小化高速VLSI互连中的延迟和串扰
机译:VLSI互连延迟最小化的层分配
机译:内置错误检测中VLSI互连中延迟和能量最小化的新颖编码方案
机译:用于VLSI系统设计的分析和统计互连延迟模型。
机译:空间延迟响应任务中的有信心和无信心错误的功能分离表明精神分裂症的工作记忆编码和维护受损。
机译:一种基于网格图的优化算法,可最大程度地减少VLSI布局设计中的互连延迟
机译:编码方案最小化光子转换器中的错误