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机译:基于兼容门的组合逻辑电路的优化
Maurizio Damiani; Jerry Chih-Yuan Yang; Giovanni De Micheli;
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机译:基于基本门的空约定逻辑的QDI组合电路综合
机译:基于遗传算法的多数门纳米电子电路的组合逻辑优化
机译:高度可测试的基于准群的组合逻辑电路。
机译:具有实际门延迟模型的CMOS组合逻辑电路的准确动态功率估算
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机译:多重兼容的输入级,特别适用于集成电路中的逻辑门
机译:集成电路的逻辑门尺寸优化过程,从而提高了电路速度,同时优化了电路面积
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