Department of Electrical Engineering, Wright State University, Dayton, OH;
机译:用于vLSI电路的虚拟穷举测试的协调电路划分和测试生成方法
机译:分区算法可增强数字VLSI电路的伪穷举测试
机译:分区算法可增强数字VLSI电路的伪穷尽测试
机译:图分割用于VLSI电路中的并行测试调度
机译:用于VLSI电路的内置自测试的划分和详尽测试模式生成的方法。
机译:具有食物和水增强剂的并发可变间隔可变间隔计划中的关键啄概率和地形。
机译:具有内置测试硬件的VLSI电路的测试时间表
机译:定制LsI(大规模集成)/ VLsI(超大规模集成电路)测试和可测试性的最新评估。第六卷。冗余,测试电路和代码。