Adders; Computer architecture; Delays; Signal processing algorithms; Pipelines; Clocks; Routing;
机译:基于经典编码算法的高效单精度浮点乘法器体系结构
机译:一种高速固定宽度浮点乘法器,使用残留物对数系统算法
机译:高速浮点乘法器的新型IEEE舍入算法
机译:使用CORDIC算法的高速单精度浮点乘法器
机译:IEEE 754单精度浮点快速傅立叶变换的硬件架构的低功耗同步设计。
机译:可逆单精度浮点减法器的设计
机译:使用展位算法的双精度浮点倍增器的有效实现