Logic gates; Circuit faults; Merging; Logic circuits; Optimization; Wires; Inverters;
机译:基于多数的进化状态分配算法用于时序电路的面积和功率优化
机译:基于DNA链位移的三输入多数逻辑门和多输入逻辑电路
机译:使用基于图的方法对VLSI逻辑电路进行节点间误差敏感性分析
机译:多数逻辑电路通过节点合并优化
机译:表征两种类型的相间节点,它们融合形成细胞动力学节点,用于裂变酵母中的可收缩环组装。
机译:在简单通用的分子平台上实现级联逻辑门和多数逻辑门
机译:基于DNa链位移的三输入多数逻辑门和多输入逻辑电路