Scalable FFT Processors and Pipelined Butterfly Units

机译：可扩展的FFT处理器和流水线蝶形单元

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This paper considers partial-column radix-2 FFT processors. The efficiency of processors based on bit-parallel multipliers, distributed arithmetic, and CORDIC is analyzed with the aid of logic synthesis.

机译：本文考虑了部分列基数为2的FFT处理器。借助逻辑综合分析了基于位并行乘法器，分布式算术和CORDIC的处理器的效率。

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来源
《International Workshop on Computer Systems: Architectures, Modeling, and Simulation(SAMOS 2003 and SAMOS 2004); 20030721-20030723 and 20040719-20040721; Samos; GR》|2003年|P.373-382|共10页
会议地点 Samos(GR);Samos(GR);Samos(GR);Samos(GR)
作者
Jarmo Takala; Konsta Punkka;
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作者单位

Tampere University of Technology, P.O.Box 553, FIN-33101 Tampere, Finland;

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会议组织
原文格式 PDF
正文语种 eng
中图分类计算技术、计算机技术;
关键词

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