高速FFT的蝶形单元和地址生成器优化

王镇道; 王宇峰; 陈迪平

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高速FFT的蝶形单元和地址生成器优化

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提出了FFT处理器的堞形单元和地址发生器优化方案.通过改进Wallace树型加法器阵列结构,提高了蝶形单元乘法器的工作频率.提出了地址快速生成算法,该算法在快速产生地址的同时降低了读取旋转因子ROM的功耗.在Xilinx的Vertex-Ⅱ系列FPGA上实现,该处理器可以稳定工作在150 MHz时钟下,速度满足设计指标.

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来源
《计算机工程与应用》 |2010年第8期|64-6670|共4页
作者
王镇道; 王宇峰; 陈迪平;
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作者单位

湖南大学;

物理与微电子科学学院;

长沙;

410082;

湖南大学;

物理与微电子科学学院;

长沙;

410082;

湖南大学;

物理与微电子科学学院;

长沙;

410082;

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原文格式 PDF
正文语种 chi
中图分类数字信号处理;
关键词
快速傅里叶变换; Wallace树; 地址生成器; 蝶形单元;

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