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王彦辉;
中国计算机学会;
HSTL; 电路模式; 功耗; 信号完整性; 逻辑电路;
机译:新型差分高速CMOS逻辑电路技术ASDL
机译:一种新的差分高速CMOS逻辑电路技术ASDL
机译:时钟分离逻辑:用于高速数字设计的双轨锁存电路技术
机译:在纳米级硅中实现毫米波和太赫兹收发器的新电路技术。
机译:荧光分子作为收发器纳米天线:基于FRET的纳米级通信通道上的首次实用且高速率的信息传递
机译:用于低压,高速和混合信号VLSIC的CMOS线与电流模式逻辑电路技术
机译:低压和高速a / D转换器的电路技术
机译:具有SIMD架构的逻辑集成DRAM的电路技术和控制低功耗,高速且高度可靠的操作的方法
机译:用于集成电路技术中的热稳定存储器高速开关逻辑电路
机译:用于总线收发器的方法和装置,该总线收发器将高速二进制数据传输模式与具有全双工,优势逻辑传输方案的三元控制传输模式相结合
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