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钱伟康; 谢灵军; 钱建秋; 王力;
中国高科技产业化研究会;
FPGA; 直接数字综合DDS; IP核; 数字信号发生器;
机译:“Laklac”FPGA设计使用-CORE发生器的图像过滤电路IP核心设计
机译:基于输入/输出缓冲器的Vedic乘法器设计,用于28nm FPGA上的热感知节能数字信号处理
机译:基于FPGA的AD控制器自定义IP核设计设计
机译:FPGA上数字信号处理的设计方法和架构。
机译:基于FPGA的电子皮肤实现实时数字信号处理
机译:基于FPGA的数字信号处理系统研究与设计
机译:基于多项式逼近的FpGa实现数值函数发生器设计方法。
机译:IP核,包含IP核和IP核设计程序的体系结构(Google翻译的机器翻译,不具有法律约束力)
机译:基于FPGA的伪随机序列发生器的设计方法。
机译:通过组合基于fpgas的数字加速器和基于对象的界面来设计通用高性能计算机应用程序的方法
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