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Master/dual-slave D type flip-flop

机译:主/双从D型触发器

摘要

An apparatus comprising a first circuit, a second circuit and a third circuit. The first circuit may be configured to receive a first input signal and a second input signal and present a first signal and a second signal. The second circuit may be configured to present a first output signal in response to the first input signal, the first signal and the second signal. The third circuit may be configured to present a second output signal in response to the second input signal, the first signal and the second signal.
机译:一种设备,包括第一电路,第二电路和第三电路。所述第一电路可以被配置为接收第一输入信号和第二输入信号并呈现第一信号和第二信号。第二电路可以被配置为响应于第一输入信号,第一信号和第二信号而呈现第一输出信号。第三电路可以被配置为响应于第二输入信号,第一信号和第二信号而呈现第二输出信号。

著录项

  • 公开/公告号US6617901B1

    专利类型

  • 公开/公告日2003-09-09

    原文格式PDF

  • 申请/专利权人 CYPRESS SEMICONDUCTOR CORP.;

    申请/专利号US20010844785

  • 发明设计人 JAY A. KUHN;

    申请日2001-04-27

  • 分类号H03K32/89;H03K33/56;

  • 国家 US

  • 入库时间 2022-08-22 00:04:26

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