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机译:优化从FIFO总线接收数据包状态
公开/公告号US2004073728A1
专利类型
公开/公告日2004-04-15
原文格式PDF
申请/专利权人 INTEL CORPORATION A CALIFORNIA CORPORATION;
申请/专利号US20030664202
发明设计人 MATTHEW J. ADILETTA;GILBERT WOLRICH;DEBRA BERNSTEIN;
申请日2003-09-16
分类号G06F13/00;
国家 US
入库时间 2022-08-21 23:19:01
机译: 优化从FIFO总线接收数据包状态
机译: 基于数据突发计数的接收FIFO控制设计和用于DMA优化的早期数据包丢弃
机译: 基于FIFO的接收数据包节流,用于接收短数据包的长字符串