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PHASE LOCKED LOOP COMPRISING A VARIABLE DELAY AND A DISCRETE DELAY

机译:包含可变延迟和离散延迟的锁相环

摘要

A phase locked loop circuit, for providing an oscillating output signal at an output frequency, comprising: a reference counter; a loop counter; a phase detector having a first input coupled to the reference counter and second input coupled to the loop counter; a voltage controlled oscillator having an input coupled to the output of the phase detector and an output for providing the oscillating output signal; a feedback loop coupling the output of the voltage controlled oscillator to the input of the loop counter; and delay circuitry, including a feedback loop, arranged to introduce a discrete delay into the output of the loop counter and/or the reference counter.
机译:锁相环电路,用于以输出频率提供振荡输出信号,包括:参考计数器;和循环计数器;相位检测器,其第一输入耦合到参考计数器,第二输入耦合到环路计数器;压控振荡器,其输入耦合到所述鉴相器的输出,并具有用于提供振荡输出信号的输出;反馈环路将压控振荡器的输出耦合到环路计数器的输入;延迟电路,包括反馈回路,被安排为将离散延迟引入到循环计数器和/或参考计数器的输出中。

著录项

  • 公开/公告号KR20050091035A

    专利类型

  • 公开/公告日2005-09-14

    原文格式PDF

  • 申请/专利权人 NOKIA CORPORATION;

    申请/专利号KR20057012268

  • 发明设计人 BEESON PETER;

    申请日2005-06-29

  • 分类号H03L7/23;H03L7/18;

  • 国家 KR

  • 入库时间 2022-08-21 22:04:33

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