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SEMICONDUCTOR MEMORY DEVICE, A TEST CIRCUIT, AND A TESTING METHOD CAPABLE OF REDUCING TIME OF TESTING A PLURALITY OF UNIT CELLS

机译:可减少多个单元电池测试时间的半导体存储器,测试电路和测试方法

摘要

PURPOSE: A semiconductor memory device, a test circuit, and a testing method are provided to inform a user of a fail state in a test mode.;CONSTITUTION: A path selecting unit transmits a first data inputted through a first data pad to a first memory cell and a second memory cell in a test mode. A test mode control unit(200) compares the first data of the first and second memory cells and controls one of a plurality of first data pads to show a fail state according to the comparison result in the test mode. The test mode control unit controls one of the plurality of the first data pads to show a stuck state after a read operation is completed when the fail state is sensed.;COPYRIGHT KIPO 2012
机译:目的:提供一种半导体存储器件,测试电路和测试方法,以在测试模式下向用户通知失败状态。组成:路径选择单元将通过第一数据焊盘输入的第一数据传输至第一存储单元和第二存储单元处于测试模式。测试模式控制单元(200)比较第一存储单元和第二存储单元的第一数据,并根据测试模式下的比较结果控制多个第一数据焊盘中的一个以显示故障状态。当感测到故障状态时,测试模式控制单元控制多个第一数据焊盘中的一个在读取操作完成之后显示卡住状态。COPYRIGHTKIPO 2012

著录项

  • 公开/公告号KR20120078570A

    专利类型

  • 公开/公告日2012-07-10

    原文格式PDF

  • 申请/专利权人 SK HYNIX INC.;

    申请/专利号KR20110088144

  • 发明设计人 DO CHANG HO;KIM YEON WOO;

    申请日2011-08-31

  • 分类号G11C29/00;G11C7/22;G11C7/10;

  • 国家 KR

  • 入库时间 2022-08-21 17:09:34

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