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Phase-lock loop

机译:锁相环

摘要

In one implementation an output signal of an oscillator is varied to be within a desired frequency band with respect to a reference signal, the output signal having a plurality of phases. The implementation may include comparing the output signal with the reference signal, counting falling edges about each phase of the number of phases in a predetermined time period and summing to define a count output; comparing the count output with a product of the number of phases of the output signal and the factor to define a comparison, generating a control signal based upon the comparison, and inputting the control signal to the oscillator to alter the output signal thereof.
机译:在一种实施方式中,振荡器的输出信号相对于参考信号被改变为处于期望的频带内,该输出信号具有多个相位。该实现可以包括:将输出信号与参考信号进行比较;在预定时间段内对相数中的每个相的下降沿进行计数;以及求和以定义计数输出;以及将计数输出与输出信号的相数和因子的乘积进行比较以定义比较,基于该比较生成控制信号,并将该控制信号输入到振荡器以改变其输出信号。

著录项

  • 公开/公告号US8704563B2

    专利类型

  • 公开/公告日2014-04-22

    原文格式PDF

  • 申请/专利权人 CHIN YEONG KOH;KAR MING YONG;

    申请/专利号US201213347586

  • 发明设计人 KAR MING YONG;CHIN YEONG KOH;

    申请日2012-01-10

  • 分类号H03L7/087;

  • 国家 US

  • 入库时间 2022-08-21 16:01:31

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