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DECODER, MINIMUM VALUE SELECTION CIRCUIT, AND MINIMUM VALUE SELECTION METHOD

机译:解码器,最小值选择电路以及最小值选择方法

摘要

A storage which, in operation, stores a first minimum value and a second minimum value each time a plurality of data are input. Round-robin comparison circuitry which, in operation, makes a magnitude comparison among the plurality of data. First selection comparison circuitry and second selection comparison circuitry which, in operation, make a magnitude comparison between the first minimum value and each of the plurality of data and a magnitude comparison between the second minimum value and each of the plurality of data, respectively. Judgment circuitry which, in operation, judges a new first minimum value and a new second minimum value on the basis of a comparison result from the round-robin comparison circuitry and comparison results from the first and second selection comparison circuitry.
机译:一种存储器,在操作中,每当输入多个数据时,该存储器就存储第一最小值和第二最小值。循环比较电路,其在操作中在多个数据之间进行幅度比较。第一选择比较电路和第二选择比较电路在操作中分别在第一最小值和多个数据中的每个之间进行幅度比较,并且在第二最小值和多个数据中的每个之间进行幅度比较。判断电路,该电路在操作中根据来自循环比较电路的比较结果以及来自第一和第二选择比较电路的比较结果来判断新的第一最小值和新的第二最小值。

著录项

  • 公开/公告号US2016241360A1

    专利类型

  • 公开/公告日2016-08-18

    原文格式PDF

  • 申请/专利权人 PANASONIC CORPORATION;

    申请/专利号US201615011709

  • 发明设计人 HIROYUKI YOSHIKAWA;HIROYUKI MOTOZUKA;

    申请日2016-02-01

  • 分类号H04L1/00;H03M13/11;

  • 国家 US

  • 入库时间 2022-08-21 14:36:59

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