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Variable delay and setup time flip-flop

机译:可变延迟和建立时间触发器

摘要

An apparatus is provided. The apparatus includes a flip-flop including an input configured to receive a setup time and delay control (SDC) signal, and an output buffer including first and second conductive paths. The second conductive path is non-conductive when the SDC signal has a first value at the input and is conductive when the SDC signal has a second value at the input. The apparatus includes a propagation delay sensor configured to estimate a propagation delay of the flip-flop, and, when the estimated propagation delay exceeds a threshold, supply the SDC signal having the second value to the input of the flip-flop.
机译:提供一种设备。该装置包括:触发器,其包括被配置为接收建立时间和延迟控制(SDC)信号的输入;以及包括第一和第二导电路径的输出缓冲器。当SDC信号在输入处具有第一值时,第二导电路径是非导电的,而当SDC信号在输入处具有第二值时,第二导电路径是导电的。该设备包括传播延迟传感器,其被配置为估计触发器的传播延迟,并且当所估计的传播延迟超过阈值时,将具有第二值的SDC信号提供给触发器的输入。

著录项

  • 公开/公告号US9231569B2

    专利类型

  • 公开/公告日2016-01-05

    原文格式PDF

  • 申请/专利权人 ALEXANDRO GIRON ALLENDE;

    申请/专利号US201313749542

  • 发明设计人 ALEXANDRO GIRON ALLENDE;

    申请日2013-01-24

  • 分类号H03K3/00;H03K3/037;

  • 国家 US

  • 入库时间 2022-08-21 14:27:43

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