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公开/公告号CN111309302B
专利类型发明专利
公开/公告日2023.04.18
原文格式PDF
申请/专利权人 杭州电子科技大学;
申请/专利号CN202010081543.6
发明设计人 黄继业;郭童栋;高明煜;谢尚港;何志伟;杨宇翔;董哲康;林辉品;
申请日2020.02.06
分类号G06F8/30(2018.01);G06F40/151(2020.01);
代理机构浙江永鼎律师事务所 33233;
代理人陆永强
地址 310018 浙江省杭州市下沙高教园区2号大街1号
入库时间 2023-06-01 21:35:15
机译: Spice到Verilog网表转换器以及使用Spice进行Verilog和Verilog进行Spice翻译的设计方法
机译: 用于在该方法的可执行代码,程序和记录介质中转换和公式转换器的方法,用于实现这种公式的方法。
机译: 在可执行代码中对公式的转换和转换器进行简要说明,并为此提供记录介质以及该公式的实现方法。
机译:基于算术的Binary-to-RNS转换器模块 $ {{2 ^ {n} {pm} k}} $ tex-math> inline- $ jn $ tex-math> inline-formula>位动态范围的公式>
机译:使用嵌入式增量式 $ Sigma Delta $ tex-math> inline的分离电容SAR ADC的简化代码静态线性测试-公式>转换器
机译:a $ k $ tex-math> inline-fapers> -nearest邻居算法 - 基于近的附近类别支持向量机方法<内联的事件识别 - 公式> $ varphi $ tex-math> Inli
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