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帧同步并行扰码器和并行解扰器

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摘要

一种用于同步数字系列传输系统的帧同步并行扰码器和并行解扰器，分别包括在一个时钟节拍同时产生并行的16比特伪随机序列的反馈移位寄存器，该反馈移位寄存器由16个D触发器组成的移位寄存器和16个异或门组成的反馈网络构成，其中16个D触发器D

法律状态公告日

法律状态信息

法律状态
2012-07-11

未缴年费专利权终止 IPC(主分类):H04B 10/02 授权公告日:20070321 终止日期:20110514 申请日:20040514

专利权的终止
2007-03-21

授权

授权
2006-01-11

实质审查的生效

实质审查的生效
2005-11-16

公开

公开

1. 帧同步并行扰码器和并行解扰器 [P] . 中国专利： CN1306732C . 2007.03.21
2. MB-OFDM系统中超快速并行扰码器与解扰器 [P] . 中国专利： CN102065055A . 2011-05-18
3. 16-bit parallel descrambling data generation circuit with 16-bit parallel descrambler [P] . 韩国专利： KR0173945B1 . 1999-04-01

机译：具有16位并行解扰器的16位并行解扰数据产生电路
4. 16-bit parallel descrambling data generation circuit of 16-bit parallel descrambler [P] . 韩国专利： KR970049379A . 1997-07-29

机译： 16位并行解扰器的16位并行解扰数据产生电路
5. PARALLELLY DISTRIBUTED SAMPLE DESCRAMBLING CIRCUIT FOR DESCRAMBLING OF CELL BASE PARALLEL ASYNCHRONOUS TRANSMISSION MODE PHYSICAL LAYER [P] . 日本专利： JPH07123074A . 1995-05-12

机译：用于基于单元并行并行传输模式物理层解扰的并行分布式样本解扰电路