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公开/公告号CN104241366B
专利类型发明专利
公开/公告日2017-06-13
原文格式PDF
申请/专利权人 台湾积体电路制造股份有限公司;
申请/专利号CN201410219414.3
发明设计人 蔡俊雄;吕伟元;詹前泰;李威养;林大文;
申请日2014-05-22
分类号H01L29/78(20060101);H01L29/08(20060101);H01L21/336(20060101);
代理机构11409 北京德恒律治知识产权代理有限公司;
代理人章社杲;孙征
地址 中国台湾新竹
入库时间 2022-08-23 09:56:47
法律状态公告日
法律状态信息
法律状态
2017-06-13
授权
2015-01-14
实质审查的生效 IPC(主分类):H01L 29/78 申请日:20140522
实质审查的生效
2014-12-24
公开
机译: 在finFET器件的源极和漏极区域中形成位错
机译: FINFET器件源极和漏极区位错的形成
机译: 布置在用作MOSFET的半导体主体中的半导体组件包括源极区和漏极区,布置在源极区和漏极区之间的主体区以及通过电介质与主体绝缘的栅电极
机译:对可靠的四位/单元操作的氧化硅-氮化物-氧化硅-硅器件漏极区附近的局部陷获电荷和界面态分布的直接观察
机译:顶部栅极自对准氧化物半导体场效应晶体管中的源极和漏极区域的形成
机译:具有由反转层形成的极浅源极和漏极区的Si MOSFET的短沟道特性
机译:嵌入式SiGe源/漏极区域的侧壁位错及其对器件性能的影响
机译:闪光灯退火多晶硅的PMOS TFT工程源/通道/漏极区
机译:大肠杆菌中的动态结构:MinE环和MinD极区的自发形成
机译:具有自对准源极/漏极区域的氧化锌薄膜晶体管掺杂注入硼以提高热稳定性
机译:在TEm中原位形成位错期间电子器件特性的变化