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前向纠错(FEC)编解码器的编码器和解码器

摘要

本文的实施例描述了一种用于生成针对消息的校验字节的FEC编解码器。该FEC编解码器包括具有存储单元、伽罗瓦域乘法器和求和单元的端口编码器。存储单元存储第一阶段结果,该第一阶段结果是基于针对从第一时钟周期到紧接在当前时钟周期之前的时钟周期的所有时钟周期的消息的输入字节的先前集合而累积的。伽罗瓦域乘法器对第一阶段结果和alpha的幂执行伽罗瓦域乘法以生成伽罗瓦域乘积。求和单元对基于当前时钟周期的合并的字节的内部输入和伽罗瓦域乘积执行伽罗瓦域加法,以生成第二阶段结果,以供随后用于生成校验字节。可以描述和/或要求保护其他实施例。

著录项

  • 公开/公告号CN113497628A

    专利类型发明专利

  • 公开/公告日2021-10-12

    原文格式PDF

  • 申请/专利权人 英特尔公司;

    申请/专利号CN202011566303.1

  • 发明设计人 D·达斯夏尔马;S·乔德里;

    申请日2020-12-25

  • 分类号H03M13/03(20060101);

  • 代理机构72002 永新专利商标代理有限公司;

  • 代理人刘瑜

  • 地址 美国加利福尼亚

  • 入库时间 2023-06-19 12:51:29

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2023-04-28

    实质审查的生效 IPC(主分类):H03M13/03 专利申请号:2020115663031 申请日:20201225

    实质审查的生效

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