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适于VLSI实现的AVS视频解码器变长解码的简化码表及实施方法

摘要

本发明公开了一种适于VLSI实现的AVS视频解码器变长解码的简化码表及实施方法。简化码表是由标准附录A的十九个变长码表推导出的大小为19×29×2=1102个字节的以level、run为元素的一维数组。上述码表的解码方法包括如下两步:1.根据索引地址访问一维数组码表求出残差矩阵的非零量化系数level及其游程run。2.判断trans_coeff的奇偶性,决定level的正负号。trans_coeff小于结束符时,若trans_coeff为奇数,则level取负值。trans_coeff大于结束符时,若trans_coeff是偶数,则level取负值。十九个元素对应着十九个表,这样就能够由统一的逻辑来处理不同的块类,达到简化逻辑的目的,最大限度地消除冗余存储和冗余运算。

著录项

  • 公开/公告号CN101365131A

    专利类型发明专利

  • 公开/公告日2009-02-11

    原文格式PDF

  • 申请/专利权人 华亚微电子(上海)有限公司;

    申请/专利号CN200810041846.4

  • 发明设计人 田野;

    申请日2008-08-19

  • 分类号H04N7/26(20060101);H04N7/50(20060101);

  • 代理机构31002 上海智信专利代理有限公司;

  • 代理人周琪

  • 地址 201203 上海市张江高科技园区松涛路696号联想大厦4层

  • 入库时间 2023-12-17 21:27:57

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2012-05-16

    发明专利申请公布后的视为撤回 IPC(主分类):H04N7/26 公开日:20090211 申请日:20080819

    发明专利申请公布后的视为撤回

  • 2009-04-08

    实质审查的生效

    实质审查的生效

  • 2009-02-11

    公开

    公开

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