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在具有金属图案的半导体基底形成堆叠式介电层的方法

摘要

本发明提供一种在具有金属图案的半导体基底形成堆叠式介电层的方法,包括下列步骤:在上述半导体基底表面形成第一介电层;以及在上述第一介电层上方形成第二介电层,以构成一复合介电层,其中上述第二介电层的介电常数(k)大于上述第一介电层的介电常数(k),上述第二介电层的硬度大于上述第一介电层的硬度,并且上述第二介电层的厚度小于上述第一介电层的厚度。最好是重复第一介电层、第二介电层的堆叠2-3次。根据本发明的方法,能够避免在介电层中产生出气现象与破裂,并且,当内连导线间的电容必须缩小时,能够符合需求。

著录项

  • 公开/公告号CN1448995A

    专利类型发明专利

  • 公开/公告日2003-10-15

    原文格式PDF

  • 申请/专利权人 矽统科技股份有限公司;

    申请/专利号CN02108497.1

  • 发明设计人 李世达;

    申请日2002-04-01

  • 分类号H01L21/31;H01L21/285;H01L21/469;

  • 代理机构北京三友知识产权代理有限公司;

  • 代理人李强

  • 地址 台湾省新竹科学园区

  • 入库时间 2023-12-17 14:57:04

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2005-04-06

    发明专利申请公布后的视为撤回

    发明专利申请公布后的视为撤回

  • 2003-12-17

    实质审查的生效

    实质审查的生效

  • 2003-10-15

    公开

    公开

  • 2002-07-24

    实质审查的生效

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