モバイルマルチメディア処理向けのスケーラブルなマルチプロセッサ

薄井弘之; 野村周央; 山根史之; 宮本幸昌; カムトーンキッティクン チャイヤスィット; 田辺淳; 内山真郷; 宮森高; 坪井芳郎; Hiroyuki USUI; Shuou NOMURA; Fumiyuki YAMANE; Yukimasa MIYAMOTO; Chaiyasit KUMTORNKITTIKUL; Jun TANABE; Masato UCHIYAMA; Takashi MIYAMORI; Yoshiro TSUBOI

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モバイルマルチメディア処理向けのスケーラブルなマルチプロセッサ

机译：用于移动多媒体处理的可扩展多媒体

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モバイルマルチメディア処理向けのマルチプロセッサを開発した．各コアは32ビットNSCプロセッサに加え，SIMD命令を実行可能なVLIWコプロセッサを持ち，広帯域のL2キヤッシュを共有している．対称かつ粗粒度な並列化方法の採用により，コア数に対する性能のスケーラビリティを実現できる．65nm CMOSプロセスで試作したチップでは8個のコアと512KBのL2キャッシュを持ち，8コアでの実行時にH.264 720p 60fpsのデコードが可能である．これは1コアでの実行時と比較して7.5倍の性能である．

机译：我们已经开发了用于移动多媒体处理的多处理器。除了32位NSC处理器之外，每个内核还具有能够执行SIMD指令的VLIW协处理器，并共享宽带L2高速缓存。通过采用对称且粗粒度的并行化方法，可以实现有关内核数的性能可伸缩性。该芯片采用65nm CMOS工艺制成原型，具有8个内核和512KB L2高速缓存，当以8个内核执行时，可以解码H.264 720p 60fps。用一个内核执行时，这是性能的7.5倍。

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来源
《電子情報通信学会技術研究報告. 集積回路. Integrated Circuits and Devices》 |2008年第28期|共5页
作者
薄井弘之; 野村周央; 山根史之; 宮本幸昌; カムトーンキッティクンチャイヤスィット; 田辺淳; 内山真郷; 宮森高; 坪井芳郎; Hiroyuki USUI; Shuou NOMURA; Fumiyuki YAMANE; Yukimasa MIYAMOTO; Chaiyasit KUMTORNKITTIKUL; Jun TANABE; Masato UCHIYAMA; Takashi MIYAMORI; Yoshiro TSUBOI;
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作者单位

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收录信息
原文格式 PDF
正文语种 jpn
中图分类微电子学、集成电路（IC）;
关键词
マルチプロセッサ; マルチメディア; Multi-processor; Multimedia; VLIW; H.264;

机译：多处理器;多媒体;多处理器;多媒体;VLIW;H.264;

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