机译:具有直接数据排序盲过采样CDR的低功耗双向链路
Univ British Columbia, Dept Elect & Comp Engn, Vancouver, BC V6T 1Z4, Canada;
Intel Corp, Hillsboro, OR 97124 USA;
Intel Corp, Hillsboro, OR 97124 USA;
Intel Corp, Hillsboro, OR 97124 USA;
Intel Corp, Hillsboro, OR 97124 USA;
All-digital phase-locked loop (ADPLL); blind oversampling (BOS); jitter tolerance; low power; voltage mode;
机译:具有直接数据测序盲目过采样CDR的低功耗双向链路
机译:关于全双工双向双向信令链路低功耗混合动力设计
机译:具有3-Tap FFE / 6-Tap DFE和22纳米CMOS中的协作CDR的4–32 Gb / s双向链路
机译:22nm CMOS中的1.2-5Gb / s 1.4-2pJ / b串行链路,带有直接数据排序盲过采样CDR
机译:用于高速串行数据链路的2-5 Gbps全差分3X过采样CDR。
机译:Bflinks:可靠的Bugfix链接通过双向引用和调整的启发式方法
机译:使用半盲式过采样的3.2 Gb / s CDR实现高抖动容限