机译:Vedic BCD乘法器使用可逆逻辑门的比较研究
School of Electronics Engineering, VIT University, Vellore, India;
School of Electronics Engineering, VIT University, Vellore, India;
School of Electronics Engineering, VIT University, Vellore, India;
School of Electrical Engineering, VIT University, Vellore, India;
BCD; cadence; reversible logic gates; urdhva-triyagbhayam; vedic mathematics; verilog HDL; xilinx;
机译:Vedic BCD乘法器使用可逆逻辑门的比较研究
机译:可逆逻辑门的吠陀乘法器的设计与实现
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机译:可逆逻辑门设计Vedic乘法器
机译:使用可逆逻辑门设计,分析和综合16位算术逻辑单元。
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机译:采用可逆逻辑门的3-1-1--压缩机高速低功耗Vedic乘法器的设计与分析