机译:源极/漏极至栅极非重叠MOSFET结构的栅极泄漏行为
Department of Electronics and Communication, National Institute of Technology, Hamirpur Hamirpur 177005, India;
Department of Computer Science and Engineering, National Institute of Technology, Hamirpur Hamirpur 177005, India;
Department of Electronics and Communication, National Institute of Technology, Hamirpur Hamirpur 177005, India;
gate tunneling current; analytical model; spacer dielectrics; drain induced barrier lowering; subthreshold slope;
机译:高κ材料侧壁具有源极/漏极至栅极非重叠结构,适用于低待机功率应用
机译:通过使用栅极至源极/漏极非重叠的金属氧化物半导体场效应晶体管结构来减少栅极泄漏
机译:纳米级非重叠栅极至源极/漏极MOSFET的栅极电流建模和优化设计
机译:具有源极/漏极至栅极非重叠结构的未掺杂薄膜FD-SOI CMOS,适用于超低泄漏应用
机译:独立双栅极SOI MOSFET晶体管泄漏电流的仿真分析。
机译:控制氧化铝微结构以减少钻石MOSFET中的栅极泄漏
机译:纳米MOSFET阈值电压的栅极漏电流不一致行为的建模与表征
机译:ZmR(区域熔化 - 再结晶)和sImOX(氧注入)sOI(绝缘体上硅)mOsFET中的栅极氧化物泄漏和电荷俘获的研究