机译:用于运行顺序算法的位级流水线VLSI架构
机译:基于位级流水线阵列结构的CMOS VLSI自定时乘法器体系结构的设计与表征
机译:基于位级流水线阵列结构的CMOS VLSI自定时乘法器体系结构的设计与表征
机译:基于位级流水线阵列结构的CMOS VLSI自定时乘法器体系结构的设计与表征
机译:VLSI为2D全通数字滤波器实现了新的比特级流水线架构
机译:基于新型快速卷积和超前流水线结构的高速低成本VLSI DSP算法。
机译:使用通用Hebbian算法的高效多通道Spike排序VLSI架构
机译:基于位级流水线阵列结构的CMOS VLSI自定时乘法器体系结构的设计与表征
机译:数字VLsI中的雷达信号处理架构和算法(超大规模集成)