机译:利用65 nm CMOS的高线性度输入开关建立优化的采样保持电路
Room 206, Microelectronics, Building, Peopleÿs Republic of China;
机译:基于CMOS开关运算放大器的采样保持电路
机译:基于CMOS开关运算放大器的采样保持电路
机译:InP-on-CMOS工艺中的高线性度,30 GS / s采样保持放大器和时间交错采样保持
机译:用于65位CMOS的14位250MS / s管线ADC的1.2V采样保持电路
机译:65 nm CMOS技术中毫米波/太赫兹电路耦合传输线的电磁建模。
机译:使用65 nm CMOS技术单片集成的CMOS-NEMS铜开关
机译:1.5至5.0GHz输入匹配+ 2dBm p1dB全无源开关电容波束成形接收器前端采用65nm CmOs封装