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机译:使用替代逻辑结构的新型高性能全加器
机译:使用高性能10-T XOR-XNOR单元的高速混合逻辑全加法器
机译:使用NAND逻辑门的高性能近似半和完整的加法器单元
机译:适用于高性能处理器的替代混合功率意识加法器
机译:使用45nm技术的时钟和非时钟逻辑样式的替代加法器单元结构的性能分析
机译:FARHAD:用于高性能处理器的容错功率感知混合加法器。
机译:原子层沉积技术在高性能RRAM交叉开关阵列中进行逻辑运算的演示
机译:采用45nm技术的摆动恢复互补通过晶体管逻辑的功耗感知加法器单元结构