机译:早期片上系统设计探索过程中的功耗感知测试计划
logic design; logic testing; power consumption; scheduling; system-on-chip; concurrent scheduling; design exploration process; estimation-based technique; fault-free chip; power consumption; power-aware test planning; power-grid model; pseudoexhaustive method; system;
机译:使用增强的矩形打包算法的功耗感知片上系统测试计划
机译:用于实时生物医学监测和分析的多处理器片上系统:ECG原型建筑设计空间探索
机译:使用模糊逻辑和过程代数的片上系统设计的最佳测试时间
机译:多处理器片上系统设计的基于仿真的功率感知架构探索
机译:基于软计算的系统级设计空间探索方法,用于片上系统设计。
机译:在膝关节手术后恢复的患者预先计划和非计划的灵活性:新开发的测试协议的设计可靠性和有效性
机译:基于多级建模技术的多处理器片上系统设计空间探索
机译:开发和测试用于海洋哺乳动物标签和被动声学信号处理的超低功耗片上系统(sOC)平台。