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王小渭; 周跃峰;
西安交通大学;
锁相环; 数字电路; 数据通信;
机译:使用可编程延迟线电路的高效全数字锁相环
机译:TDC电路与亚稳态的优化和设计的全数字锁相环
机译:探索电路适配以优化低功耗全数字锁相环的良率
机译:内置自测试电路,用于全数字锁相环
机译:低抖动,宽锁定范围全数字锁相环和延迟锁相环的研究和设计。
机译:高速调频原子力显微镜的宽带低延迟锁相环电路设计的定量比较
机译:基于电荷泵锁相环类比的全数字锁相环设计程序
机译:多速率数字滤波器组在宽带全数字锁相环设计中的应用
机译:用于分数N锁相环频率合成器的同步调制全数字delta-sigma调制器电路,具有数字未调制分数控制信号处理全数字delta-sigma调制器电路
机译:具有时间数字转换器电路的全数字锁相环,该电路具有动态可调的偏移延迟
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