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崔昌栋; 鞠大鹏; 李兆麟;
清华大学计算机科学与技术系;
北京100084;
高速缓存; 低功耗; 路选择; 可配置;
机译:采用二级过滤方案的低功耗高速缓存的设计与分析
机译:采用下一代垂直磁化MTJ的高速,低功耗高速缓存存储器分层技术的常关处理器
机译:用于高性能和低功耗CPU内核的选择集可调整大小的高速缓存存储器设计
机译:通过1.8V0.18μmFoundry CMOS技术实现的低压,低功耗VLSI系统应用中的1V,3.44ns,4.1mW,50MHz,128Kb四路集相关CMOS高速缓存
机译:采用亚阈值设计技术的超低功耗处理器设计。
机译:用于汽车压力和温度复合传感器的信号调理IC中采用180 Nm CMOS技术的低功耗小面积符合AEC-Q100标准的SENT发送器的设计
机译:采用65 nm CMOS技术实现的超低功耗,低成本60 GHz接收器前端的设计
机译:采用现场可编程门阵列技术的aYK-14 VHsIC处理器模块适配器的设计恢复和实现
机译:低功耗高速缓存的高速路选择方案
机译:在基于时钟网格的设计中采用使电路实现大数量推和拉有用斜度计划的新型低功耗最小扰动方法
机译:通过明智的模块选择实现低功耗电路设计
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