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穆玉珠; 王术群;
西南民族大学电气信息工程学院;
计数器; 74LS192; 数字电路;
机译:二进制计数器,计数周期为加法器的一半,与计数器大小无关
机译:使用基于查找表的现场可编程门阵列的低功耗和高效区域二进制编码十进制加法器设计
机译:基于计数器树图的冗余算术加法器设计系统方法
机译:基于CMOS的三进制全加法器和三进制编码十进制(TCD)加法器电路的设计和仿真
机译:量子点元胞自动机中的64位面积有效二进制加法器。
机译:基于核糖调节的活细胞中的二进制加法
机译:使用通过CMOS半浮栅器件设计的平衡三进制计数器进行快速加法
机译:基于分圆多项式的最大长度二进制序列的移位和加法性质
机译:名词[n i Sub>] f(2 i Sub>(Σ)的功能结构> n Sup>)和[m i Sub>] f(2 n Sup>)使用三进制数系统f(+ 1,0,-1)(版本的算术公理) (俄罗斯逻辑)
机译:电子数字加法电路,用于二进制编码的十进制数字-包含值5处理双全加法器,加法器级不需要额外的进位处理输入
机译:二进制加法单元和由这种二进制加法单元组成的快速加法和乘法单元
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