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尹晓琦; 殷奎喜; 赵华; 柯伟;
南京师范大学,物理科学与技术学院,江苏,南京,210097;
淮阴工学院,电子信息工程系,江苏,淮安,223001;
LDPC码; 半随机校验矩阵; QuartusII5.0; VerilogHDL;
机译:基于降低复杂性XOR树的IEEE 802.11n / AC / AX QC-LDPC编码的多型全平行LDPC编码器
机译:基于半高斯近似的LDPC编码BICM设计
机译:基于SIMD架构的CMMB改进LDPC编码器设计。
机译:WiMAX中用于LDPC编码器/解码器的VLSI体系结构。
机译:基于条件变分自编码器的分子发生模型从头设计分子
机译:使用Verilog-HDL高效和低延迟的Turbo编码器设计
机译:用于块循环LDpC码的编码器
机译:Spice到Verilog网表转换器以及使用Spice进行Verilog和Verilog进行Spice翻译的设计方法
机译:LDPC LDPC LDPC编码器和LDPC编码方法
机译:短半稳定LDPC准循环编码器和解码器,用于低功耗应用,例如远程转发
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