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汤惟; 葛保建;
江汉大学,数学与计算机科学学院,武汉,430056;
武汉科技大学,计算机学院,武汉,430081;
FPGA; 软硬件协同; SOPC; NIOS Ⅱ; IP CORE;
机译:通过基于FPGA的多模态SoPC的结构调整来减少功率预算变化和硬件故障的运行时
机译:具有IP内核的“轻松” FPGA设计-使用SOPC Builder设计基本的I / O和SDRAM控制电路
机译:使用基于FPGA的多任务SOPCS进行空间型应用的动态结构调整片上热平衡
机译:基于FPGA的MPEG-4视频编码器SOPC设计,具有运动估计块的性能加速。
机译:基于分形特征的跌倒检测系统软硬件协同设计
机译:基于FPGA的USB主控芯片软硬件协同设计与验证
机译:基于单事件翻转发生率的基于sRam的FpGa设计中的容错实现
机译:FPGA SVM安全系统用于挖掘机使用SVM和神经气相基于FPGA和FPGA
机译:完全是基于FPGA的故障的事务语义,一旦发生了基于FPGA的故障
机译:生成时钟信号,以实现基于周期的,可重复的基于FPGA的FPGA硬件加速器
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