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面向100Gbps网络应用的RISC-V CPU设计与实现

     

摘要

RISC-V作为新一代开源精简指令集,具有功耗低、面积小和性能高的优点,因此基于RISC-V架构的技术和产品发展迅速.然而,目前基于RISC-V架构的中高端64位CPU设计实例很少,也缺乏相应的商用IP,尤其是在面向高速网络应用方面.因此,首先改进了开源的64位U500 RISC-V SoC,包括增加了总线宽度和集成二级缓存等;然后在CPU中实现了完整的100 Gbps以太网功能模块,包括介质访问控制子层、物理编码子层和串行器/解串器以及用于该功能模块的发送缓冲区和接收缓冲区;最后通过前端仿真、FPGA验证以及启动Linux操作系统,验证了所设计的64位RISC-V CPU以及100 Gbps以太网功能模块的正确性和有效性.所设计的RISC-V CPU和100 Gbps以太网功能模块可应用于智能网卡等数据中心应用场景.

著录项

  • 来源
    《计算机辅助设计与图形学学报》 |2021年第6期|956-962|共7页
  • 作者单位

    中国科学院计算技术研究所高通量计算机研究中心 北京 100190;

    中国科学院大学计算机科学与技术学院 北京 100049;

    中国科学院计算技术研究所高通量计算机研究中心 北京 100190;

    中国科学院大学计算机科学与技术学院 北京 100049;

    北京航空航天大学计算机科学与工程学院 北京 100191;

    中国科学院半导体研究所超晶格国家重点实验室 北京 100083;

    中国科学院微电子研究所系统封装与集成研发中心 北京 100029;

    中国科学院计算技术研究所高通量计算机研究中心 北京 100190;

    中国科学院大学计算机科学与技术学院 北京 100049;

    中国科学院计算技术研究所高通量计算机研究中心 北京 100190;

    中国科学院半导体研究所超晶格国家重点实验室 北京 100083;

    中国科学院微电子研究所系统封装与集成研发中心 北京 100029;

    北京航空航天大学计算机科学与工程学院 北京 100191;

  • 原文格式 PDF
  • 正文语种 chi
  • 中图分类 TP391.41;
  • 关键词

    RISC-V; 片上系统; 100 Gbps以太网; 介质访问控制子层; 物理编码子层; 串行器/解串器; 智能网卡;

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