静态时序分析在数字ASIC设计中的应用

陈敏; 殷瑞祥; 郭瑢; 曾爱华

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静态时序分析在数字ASIC设计中的应用

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主要介绍了静态时序分析在数字ASIC设计中的应用,描述了静态时序分析的基本原理和流程,并以I2C总线设计为例,分析了对数字ASIC作静态时序分析中可能出现的问题,提出了消除虚假路径的实际方法.通过对全芯片进行静态时序分析,可以确认设计的准确性和可靠性,从而为设计流程中每一部分的工作取得sign-off提供可靠保证.

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来源
《重庆理工大学学报》 |2005年第8期|51-55|共6页
作者
陈敏; 殷瑞祥; 郭瑢; 曾爱华;
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作者单位

华南理工大学电子与信息学院;

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原文格式 PDF
正文语种 chi
中图分类设计;
关键词
专用集成电路(ASIC); 静态时序分析(STA); I^2C; 时序约束; 虚假路径;

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