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尹国丽; 林争辉; 刘彦松;
上海交通大学电子工程系;
大规模集成电路; 时序电路; 锁存器; 建立时间约束; 保持时间约束; 算法;
机译:统计时序分析中的并发路径选择算法
机译:用于时钟树规划中的统计时序分析的互连延迟可变性计算的有效归约算法
机译:基于FPGA的静态时序分析中时序图遍历算法的研究
机译:针对VLSI电路的非高斯变化源的统计静态时序分析中的最大操作。
机译:用于长期环境暴露和疾病计数的时序分析中季节性和长期时间趋势的替代调整
机译:INTEGRaL的时序分析:比较不同的重建算法
机译:统计静态时序分析中规范时序值表示的叠加
机译:高层时序分析过程中宏时序模型的动态更新
机译:使用查找表的静态时序分析过程中的动态和自适应时序灵敏度
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