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张涛; 邹雪城; 刘三清; 黄晓敏; 沈绪榜;
华中科技大学模式识别与人工智能研究所图像信息处理与智能控制教育部重点实验室;
华中科技大学电子科学与技术系;
低压差分信号; 锁相环; 倍频器; 自适应电荷泵; 相位噪声;
机译:CMOS 0.18μm600 MHz时钟乘法器PLL和伪LVDS驱动器,用于ALICE内部跟踪系统前端芯片的高速数据传输
机译:具有两相PVT校准器的低相位噪声注入锁定可编程参考时钟倍频器,用于 src =“ / images / tex / 499.gif” alt =“ Delta Sigma”> < / formula> PLL
机译:eCDR-PLL,一种耐辐射的ASIC,用于时钟和数据恢复以及确定性相位时钟合成
机译:用于LVDS Serdes的电荷泵PLL的设计
机译:用于全光网络中突发模式时钟和数据恢复的宽带PLL解决方案的设计。
机译:拴系归巢基因驱动器:一种用于空间受限的种群置换和抑制的新设计
机译:一种用于电力推进的开关磁阻电动机驱动器的设计
机译:时钟产生电路,PLL电路,半导体器件以及用于设计和制造时钟产生电路的方法
机译:绿色技术平台,用于MS0-GBQ-AMC-LCO时钟,无PLL SerDes,轮胎安全性,无电感器-PDSL和无孔ESDSL-PCB上的绿色芯片设计
机译:一种用于设计用于产生旋转或扭曲的螺纹的机器的驱动器的方法
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