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韩行州; 贾杏池; 吕洪国;
嵌入式内核; 测试; 芯片; 固件设计;
机译:一种针对嵌入式内核的内部和边界扫描攻击的安全测试包装设计
机译:功率约束下具有多个时钟域的嵌入式内核的测试封装设计和优化
机译:包装扫描链设计,用于嵌入式内核的快速和低功耗测试
机译:设计用于3D嵌入式内核的预粘合和粘合后测试的3D测试包装
机译:使用片上嵌入式测试内核的模拟和混合信号测试方法。
机译:使用多内核序列内核关联测试(MK-SKAT)跨方法和阈值进行稀有变异测试
机译:sOC测试 - 架构优化,用于测试核心 - 外部互连上的嵌入式内核和信号完整性故障
机译:microsemi RTaX4000D现场可编程门阵列(FpGa)器件中嵌入式Dsp内核的单事件效应(sEE)测试
机译:用于设计计算机实现的嵌入式测试的方法,用于设计嵌入式测试的系统以及用于设计嵌入式测试的计算机程序产品
机译:用于创建具有嵌入式内核的可测试电路设计的方法和装置
机译:使用伪引脚生成扫描测试向量以测试嵌入式内核,同时保持其中包含的IP
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