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基于FPGA的OS-CFAR设计与实现

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摘要

雷达在多目标检测中采用有序恒虚警率(OS-CFAR)检测器具有更好的抗干扰能力.本文根据OS-CFAR检测器原理,设计了一种基于FPGA实现方案,利用FPGA面积换取速度的设计思想,采用并行比较的方法,解决了排序耗时长的问题,实现对所有点进行检测,通过仿真验证了设计的正确性.

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来源
《中国集成电路》 |2019年第1期|39-42|共4页
作者
王瑞; 贺鹏飞; 刘鹏飞;
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作者单位

烟台大学光电信息科学技术学院;

山东烟台;

264005;

烟台大学光电信息科学技术学院;

山东烟台;

264005;

烟台大学光电信息科学技术学院;

山东烟台;

264005;

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原文格式 PDF
正文语种 chi
中图分类
关键词
恒虚警率; 现场可编程逻辑门阵列; 并行比较; 排序;

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