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时钟集成电路; 抖动性能; 输出速度; RF; ADI; 压控振荡器; 仪器设备; 数据转换;
机译:多速率时钟发生器具有最低的抖动
机译:具有非累积参考时钟抖动的二阶数字Bang-Bang锁相环的输出抖动性能
机译:具有抖动抑制功能的10 Gb / s,1.24 pJ / bit突发模式时钟和数据恢复
机译:用于高性能低功耗CTΣΔ调制器时钟抖动不敏感多维测DAC架构的时钟抖动不敏感多维测架构的设计问题和性能限制
机译:具有宽锁定范围的低抖动锁相环时钟合成。
机译:具有能量收集功能的敏捷的阻滞器和时钟抖动容限低功率频率选择接收器
机译:具有非累积参考时钟抖动的二阶数字Bang-bang锁相环的输出抖动性能
机译:具有抖动时钟的Delta调制的扩频数据通信系统的设计与性能。
机译:时钟和时钟调整电路可将抖动降至最低
机译:带有抖动的时钟脉冲再生装置,具有将时钟脉冲转换成锯齿形的无抖动侧面信号的转换单元,并提供用于产生再生时钟脉冲的生产单元
机译:具有改善的采样时钟抖动性能的ADC
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